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Ieri, 13:46 | #1761 |
Senior Member
Iscritto dal: Sep 2020
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Riva Tuner e via
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Ieri, 17:09 | #1762 | |||||
Senior Member
Iscritto dal: Mar 2007
Messaggi: 20933
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Quote:
Con zen6 si dovrebbe svoltare sulle latenze tra CCD, e vogliamo tornare ai CCX. Riguardo il 8700g, grazie alla struttura CCD, mantiene tutti rapporti core to core ed IPC di zen4, ma dove serve la cache, sbanda terribilmente, vedi giochi e compressioni. Chiaro, va bene nel calcolo, come anche un CB, ma li pure con 96mb di cache non guadagni. Quote:
Se tu avessi 10ghz, anzichè 5, avresti 2x la banda l1/l2/l3. Quella non viene tagliata. Con le ram più veloci, tramite ghz/latenza avrai valori migliori, ma questo è un'altra cosa. Quote:
Come vedi sui 32 core, raddopierà pure la l3 che è oltre 1/3 di die. Intel infatti, per collegare gli e core, gli ha aumentato la l3, ed ha dovuto bombardare di l2 (che è molto più grossa della l3) per evitare che gli ecore si mangiassero la loro l2 e saturassero buona parte di l3. I p-core, se non avesso gli e core, avrebbero 24mb di l3 e 16mb di l2. Con gli e core, passano a 36mb di l3 e ben 32mb. Di fatto raddoppiano la l2 e 1,5 la l3. Come vedi, per mantenere quei core extra, devono bombardare di cache, non a caso raptor è una padella da quasi 260mm2, roba da rtx 4070ti quasi. Inoltre gli e core non sono come i core dense, sono stati proprio una pezza, in quanto era inconcebile mettere 16 p core, altrimenti non ricorevvi a questo. Lo sai che la latenza ibrida core to core è equivalente a quella di zen2? L'ibrido volendo potresti pure farlo su AMD, tramite un CCD basic ed uno Dense, oppure, non potendo dividere in 2 CCX, colleghi un 8+16 ad una cache molto più grande, ed ecco che ti serve densità. Il calcolo che fai tu, è trovare un modo per avere performance brute, sacrificando l'IPC e il ST a scappito del puro MT. Quote:
Con i 3nm, hai densità sufficiente a poter realizzare un 16 core totale, ma il problema resta sempre la cache l3. Salvo non lanci le CPU già impilate. Per farti un'esempio, 8 core zen4, hanno densità di 92mtx mm2 su 30mm2. 16 core zen4 per farceli stare su 30mm2, ti servirebbe 184mt xmm2 (densità da 3nm), e purtroppo la cache non viene dimezzata con i 3nm, quindi per passare a 64 dovresti allargare il CCD. Ovviamente su zen4, ma con i prossimi i transistor saranno molti di più per core. Quote:
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Ieri, 17:26 | #1763 |
Senior Member
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K. Devo assimilare
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7950X - X670E Asrock PG - Aio 360 Thermaltake - RS/DU TDP max 230W - CB23 39.117 https://ibb.co/M9j2bV7 - CPU-Z 815/16427 https://valid.x86.fr/jdgu90 - No overdrive - OCBench NO RS CB23 40.697 https://ibb.co/W0qnRQB - Codifica video https://ibb.co/Jm5Zj0M |
Ieri, 21:00 | #1764 | ||
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Intanto c'è una chicca, che se confermata sarebbe una botta pazzesca.
Il rendering AMD Strix Halo rivela il potente design dell'APU Ryzen: 16 core Zen 5, 40 core GPU RDNA 3+, cache L3 da 64 MB Quote:
Fino a 16 core 64 MB di cache L3 condivisa 40 unità di calcolo RDNA 3+ Cache MALL da 32 MB (per iGPU) Controller di memoria LPDDR5X-8000 a 256 bit Motore XDNA 2 integrato Fino a 70 AI TOP 16 corsie PCIe Gen4 Lancio della seconda metà del 2024 (previsto) Piattaforma FP11 (55W-130W) Tenete presente che un 7700X arriva a 142W PPT, questo è un X16 con una iGPU da 40 CU e arriverebbe al massimo a 130W. Certo che (se vero) sto N4P tirerebbe da bestia. Quote:
https://wccftech-com.translate.goog/...t&_x_tr_pto=sc Altre info da leggere qui. https://www-pcgamesn-com.translate.g...t&_x_tr_pto=sc https://hothardware-com.translate.go...x_tr_hist=true Qui invece Ryzen AI 9 HX 170 “Strix Point” https://hardwaretimes-com.translate....t&_x_tr_pto=sc
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7950X - X670E Asrock PG - Aio 360 Thermaltake - RS/DU TDP max 230W - CB23 39.117 https://ibb.co/M9j2bV7 - CPU-Z 815/16427 https://valid.x86.fr/jdgu90 - No overdrive - OCBench NO RS CB23 40.697 https://ibb.co/W0qnRQB - Codifica video https://ibb.co/Jm5Zj0M Ultima modifica di paolo.oliva2 : Ieri alle 21:26. |
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Ieri, 23:13 | #1765 |
Senior Member
Iscritto dal: Mar 2002
Messaggi: 1667
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per lo piu' e' un riassunto dei vari rumor precedenti, di nuovo pare che forse all'interno del GCD ci sono anche dei core LP, ma se vero, a che pro, in che quantita' e configurazione..sperem per il computex
interessante il nuovo collegamento INFO tra chiplet e GCD, forse mikael puo' delucidarci, magari migliora proprio alcuni tipi di latenze..
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La legge di Moore è morta, sostituita dalla legge di Huang Le gpu raddoppieranno di prezzo ogni due anni.. |
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