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15-10-2011, 13:52 | #321 | ||
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ok, mediamo sul 150% di media
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15-10-2011, 14:00 | #322 | |
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Sarebbe un ottimo risultato, il fatto è che ci sono altri 800 milioni di transistor spuntati da chissà dove. Almeno, questo è il calcolo, considerando i 213 milioni di transistor a modulo dichiarati da AMD a suo tempo. Non è una questione di SMT vs CMT, perché il CMT ha comunque consentito il pareggio. Il raddoppio dei transistor rispetto a thuban non è colpa sua! In ogni caso io continuo a pensare che dovrebbero implementare un SMT su ogni core (assieme al CMT), così da ridurre l'impatto della loro BP cessosa. Non è un problema di processo produttivo secondo me. 2 miliardi di transistor a 3,6GHz (ok, metà sono a 2,2GHz...) sono un ottimo risultato, che non reputo assolutamente raggiungibile con il processo a 45nm. Se i trnasistor fossero stati in numero umano, 1 miliardo - 1,4 miliardi, i 4,3GHz erano sicuri. Se questa CPU ha il doppio dei transitor delle altre non puoi mica sperare di spararla a 4,3GHz... Bulldozer così com'è è un camion... puoi anche mettergli il low-k, puoi ottimizzare il processo, ma non lo fai diventare un go-kart! Laborghini cala i kg ad ogni generazione, oltre ad aumentare i cavalli... Qui invece si è passati dal peso di una gallardo a quello di un range rover... Puoi mettergli il 4.4 a benza biturbo, ma anche un boxterino col 2.9 turbo te la mette nelle chiappe....
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15-10-2011, 14:09 | #323 |
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15-10-2011, 14:15 | #324 |
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15-10-2011, 14:18 | #325 |
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15-10-2011, 14:19 | #326 |
Bannato
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Trinity non avrà penso i problemi di essere troppo grosso come die size.
Già si sa che verranno tolti i 4 link HT,2 moduli e tutta la L3 che occupano tutti parecchio spazio. Magari ottimizzeranno la logica di controllo rispetto a Zambezi da fargli occupare meno spazio,ma non il controller di memoria che credo richiederà lo stesso spazio. Riguardo il controller PCI-ex non so quanto spazio occuperà. Poi dovrebbe riuscire a metterci anche una GPU con 640SP di classe WILV4 e alla fine la superficie di Trinity sarà forse leggermente più grande di Llano. |
15-10-2011, 14:23 | #327 | |
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Non penso che l'uncore consumi uno sproposito, ma da che mondo e mondo più il chip è grosso più fai fatica a salire... E comunque la cache è sempre stata un limite, anche se non pesante al clock dei processori.. I conti non li faccio io da solo, sono riportati anche qui: http://www.xbitlabs.com/news/cpu/dis...er_Fiasco.html Lasciando stare la news che secondo me è solo in parte credibile. In ogni caso converrai con me che non si può dire che il PP è cattivo perché non fa arrivare questo camion a 4,3GHz. Io trovo invece che 2 miliardi di transistor (il doppio di thuban) a 3,6GHz (maggiore di thuban) con gli stessi consumi sia un ottimo risultato, e non mi sarei mai aspettato di più. Potete guardare i miei post di gennaio, quando prognosticavo un X8 a 3,5 - 3,6GHz e un X4 a 4,2 - 4,5GHz...
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15-10-2011, 14:29 | #328 | |
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15-10-2011, 14:32 | #329 | |
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Niente male davvero. Certo è inspiegabile che 8150 con un clock superiore del 44% abbia un TDP superiore del 257%. A titolo di confronto tra un i7 mobile e i7 2600k a fronte di un clock superiore del 41% il TDP aumenta del 111%. In altre termini se i consumi di bulldozer in funzione della frequenza avessero lo stesso andamento il TDP di un 8150p doveva essere di 75W. Chi sa spiegarmi questa enorme differenza? Ultima modifica di tuttodigitale : 15-10-2011 alle 14:36. |
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15-10-2011, 14:42 | #330 | |
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Quindi togli, metti, 15W dal portatile, toglili dal 2600k e rifai il rapporto. E già qualcosa è cambiato...
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15-10-2011, 14:43 | #331 | |
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Piledriver non avrà la cache L3 ed è basato su BD2; inoltre su campo mobile sono previsti modelli con un TDP massimo di 60w ad un minimo di 35W. Per quanto riguarda Trinity per il mercato desktop ci si aspetta che aumenti le prestazioni soprattutto nella GPU mantenendo almeno lo stesso consumo delle soluzioni Llano.
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15-10-2011, 14:48 | #332 | |
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Considerando il modulo potrebbe essere... a questo punto è necessario capire se è più semplice potenziare il BP o aggiungere l'HT. l'HT la vedo più difficoltosa da implementare vista l'organizzazione CMT... Sperando di non spararla grossa, potrebbero raddoppiare i BP, con 1 solo core sembra essere sufficiente... EDIT: a proposito dei 2Mld di transistor... è evidente che BD è una cpu server... ricordate che lo davano con 1MB di L2 a modulo? non hanno avuto tempo di "segare" tutte le parti server in eccesso... probabilmente utilizzeranno questa prima incarnazione di BD anche come test per interlagos... per poi tagliare tutto il non necessario...
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15-10-2011, 14:57 | #333 | |||
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IMHO, quando le rese del 32nm saranno accettabili uscirà un FX a doppio modulo nativo Ultima modifica di tuttodigitale : 15-10-2011 alle 15:04. |
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15-10-2011, 14:59 | #334 | |
Bannato
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innanzitutto ti rinnovo i complimenti per tutta la bravura e la pazienza messa in campo per tenere in piedi tutti questi thread ufficiali. Complimenti davvero! Passiamo invece alla mia domanda: il core piledriver, alias BD2, sarà comune sia agli FX 4/6/8 core su AM3+, sia agli FX 6/8/10 core su FM2 sia ai due moduli contenuti in trinity? Da cui nessuno avrà più cache di terzo livello? No perché devo aver capito male io qualche passaggio Io pensavo che la versione senza cache l3 fosse quella solo di trinity, mentre sia quella su FM2 sia quella per am3+ avessero la L3.... Ultima modifica di Mister D : 15-10-2011 alle 15:10. |
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15-10-2011, 15:01 | #335 | |
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Hai presente il modulo con un core disattivato da bios? Ebbene, anziché disattivarlo da bios, TOGLI ogni transistor dedicato a quel core, porti la L2 ad 1MB e la L3 ad 1MB a modulo. I moduli li porti a 8, quindi sempre un 8TH come l'8150p TUTTI completamente fisici e non logici, avresti subito un incremento di IPC ST, l'MT pure... però probabilmente a frequenze inferiori ma di poco per via di un TDP superiore per un IPC superiore. La logica Turbo rimarrebbe inalterata... tutto si limiterebbe ad un TAGLIA ed INCOLLA. Se proprio si volesse strafare, porti la L2 a 512KB e la L3 la aumenti del 50% e la rendi inclusiva.
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15-10-2011, 15:03 | #336 | |
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15-10-2011, 15:15 | #337 | |
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15-10-2011, 15:20 | #338 | |
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Rimanendo più con i piedi per terra trovo più facile che piledriver non abbia più tutti quei link hipertransport risparmiando un bel pò di silicio, che abbia il controller pci-ex integrato, un BPU migliorata e più frequenza. Ovviamente in due packing, uno am3+ con il controller PCI-ex disabilitato e uno per FM2 con l'aggiunta di un modulo per la versione da 10 core, sempre che la facciano. Tutto condito da maggiori frequenze e consumi inalterati. Mentre per trinity toglieranno ai due moduli anche la L3. Così accontenti i clienti che hanno già la scheda madre am3+ (che altrimenti avrebbe una vita brevissima) e metteresti le basi per avere un socket unito FM2. Io trovo più probabile questa di soluzione e mi sembra che le slide vadano in quella direzione. Poi va bè che il marketing di amd purtroppo non va preso troppo sul serio però penso che quelle slide abbiano un buon fondo di verità! |
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15-10-2011, 15:21 | #339 | |
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sarebbe più semplice fare solo un taglia (immagino mesi ma meno di un anno) vedi core stars.
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15-10-2011, 15:28 | #340 | |
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Spero sempre in qualche ottimizzazione "a mano" di qualche componente che escluso l'incremento previsto per Piledriver faccia avvicinare quel 150% al 180%
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